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第三章 #邏輯門的靜態(tài)特性 3.3 復雜邏輯門的靜態(tài)特性

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合集?·?【清華大學】數(shù)字超大規(guī)模集成電路設(shè)計 (127集)
第26集??

第三章 #邏輯門的靜態(tài)特性 3.3 復雜邏輯門的靜態(tài)特性

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第四章 #數(shù)字集成電路的速度 4.1 CMOS反相器的延時(4)

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第四章 #數(shù)字集成電路的速度 4.1 CMOS反相器的延時(5)

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第四章 #數(shù)字集成電路的速度 4.1 CMOS反相器的延時(3)

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第四章 #數(shù)字集成電路的速度 4.2 復雜邏輯門的延時(1)

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第四章 #數(shù)字集成電路的速度 4.2 復雜邏輯門的延時(2)

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第四章 #數(shù)字集成電路的速度 4.2 復雜邏輯門的延時(4)

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第34集??

第四章 #數(shù)字集成電路的速度 4.3 邏輯門延時模型

10:35
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第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(1)

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第36集??

第四章 #數(shù)字集成電路的速度 4.4 CMOS邏輯門的延時特性(2)

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第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(4)

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第38集??

第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(2)

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第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(3)

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第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(6)

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第四章 #數(shù)字集成電路的速度 4.6 總結(jié)

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第五章 #數(shù)字集成度的功耗 5.1 引言—集成電路的功耗問題

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第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動態(tài)功耗(1)

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第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動態(tài)功耗(2)

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第五章 #數(shù)字集成度的功耗 5.3 CMOS邏輯門的靜態(tài)功耗(1)

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第五章 #數(shù)字集成度的功耗 5.4 功耗優(yōu)化技術(shù)(1)

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第七章 #組合邏輯門的設(shè)計 7.2 有比邏輯(1)

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第七章 #組合邏輯門的設(shè)計 7.3 傳輸管邏輯(2)

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