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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于Verilog_HDL的樂曲演奏電路設(shè)計(jì)

基于Verilog_HDL的樂曲演奏電路設(shè)計(jì)

2013-12-17 | doc | 267KB | 次下載 | 2積分

資料介紹

隨著EDA技術(shù)的進(jìn)展,基于可編程數(shù)字電子系統(tǒng)設(shè)計(jì)的完整方案越來越受到人們的重視。與利用微處理器(CPUMCU)來實(shí)現(xiàn)樂曲演奏相比,以純硬件完成樂曲演奏電路的邏輯要復(fù)雜得多,如果不借助于功能強(qiáng)大的EDA工具和硬件描述語(yǔ)言,僅憑傳統(tǒng)的數(shù)字邏輯技術(shù),即使最簡(jiǎn)單的演奏電路也難以實(shí)現(xiàn)。如何使用EDA工具設(shè)計(jì)電子系統(tǒng)是人們普遍關(guān)心的問題。本課程設(shè)計(jì)主要是采用FPGA器件驅(qū)動(dòng)小揚(yáng)聲器構(gòu)成一個(gè)樂曲演奏電路,F(xiàn)PGA器件選擇Altera的EPF10K10,在MAX + plusⅡ的EDA軟件平臺(tái)上,實(shí)現(xiàn)了樂曲演奏電路的設(shè)計(jì)。
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