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一般地說(shuō)，集成電路的設(shè)計(jì)過(guò)程可分為前端設(shè)計(jì)和后端設(shè)計(jì)兩大階段。 在前端設(shè)計(jì)階段，根據(jù)用戶(hù)與設(shè)計(jì)工程師一起確定設(shè)計(jì)要求實(shí)現(xiàn)功能與時(shí)序正確的邏輯網(wǎng)表。 在后端設(shè)計(jì)階段，由邏輯網(wǎng)表產(chǎn)生相應(yīng)的集成電路版圖。 高層級(jí)設(shè)計(jì)技術(shù)是本公司設(shè)計(jì)超大規(guī)模集成電路的主要方法。相對(duì)于邏輯圖輸入的設(shè)計(jì)方法，高層級(jí)設(shè)計(jì)方法具有設(shè)計(jì)速度快，不依賴(lài)于特定工藝和時(shí)鐘等優(yōu)點(diǎn)。
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