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電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開(kāi)發(fā)>Verilog設(shè)計(jì)與驗(yàn)證

Verilog設(shè)計(jì)與驗(yàn)證

2010-02-09 | rar | 1954 | 次下載 | 5積分

資料介紹

非阻塞賦值

示例編號(hào)

Example-4-1

相關(guān)章節(jié)

第4章4.3.1小節(jié)

教學(xué)目標(biāo)

非阻塞賦值的基本語(yǔ)法

補(bǔ)充說(shuō)明

對(duì)于時(shí)序邏輯,即always模塊的敏感表為沿敏感信號(hào)(多為時(shí)鐘或復(fù)位的正沿或負(fù)沿),統(tǒng)一使用非阻塞賦值“<=”

阻塞賦值

示例編號(hào)

Example-4-2

相關(guān)章節(jié)

第4章4.3.1小節(jié)

教學(xué)目標(biāo)

阻塞賦值的基本語(yǔ)法

補(bǔ)充說(shuō)明

對(duì)于always模塊的敏感表為電平敏感信號(hào)的組合邏輯,統(tǒng)一使用阻塞賦值“=”

連續(xù)賦值

示例編號(hào)

Example-4-3

相關(guān)章節(jié)

第4章4.3.1小節(jié)

教學(xué)目標(biāo)

連續(xù)賦值的基本語(yǔ)法

補(bǔ)充說(shuō)明

對(duì)于assign關(guān)鍵字描述的組合邏輯(通常稱(chēng)之為連續(xù)賦值語(yǔ)句),統(tǒng)一使用“=”, 變量被定義為wire型信號(hào)

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