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如何抑制PLL雜散信號(hào)?談射頻電路的電源和接地設(shè)計(jì)技術(shù)

2010-12-26 | rar | 658 | 次下載 | 10積分

資料介紹

射頻(RF)電路的電路板布局應(yīng)在理解電路板結(jié)構(gòu)、電源布線和接地的基本原則的基礎(chǔ)上進(jìn)行。本文探討了相關(guān)的基本原則,并提供了一些實(shí)用的、經(jīng)過驗(yàn)證的電源布線、電源旁路和接地技術(shù),可有效提高RF設(shè)計(jì)的性能指標(biāo)。考慮到實(shí)際設(shè)計(jì)中PLL雜散信號(hào)對(duì)于電源耦合、接地和濾波器元件的位置非常敏感,本文著重討論了有關(guān)PLL雜散信號(hào)抑制的方法。為便于說明問題,本文以MAX2827802.11a/g收發(fā)器PCB布局作為參考設(shè)計(jì)。

設(shè)計(jì)RF電路時(shí),電源電路的設(shè)計(jì)和電路板布局常常被留到了高頻信號(hào)通路的設(shè)計(jì)完成之后。對(duì)于沒有經(jīng)過認(rèn)真考慮的設(shè)計(jì),電路周圍的電源電壓很容易產(chǎn)生錯(cuò)誤的輸出和噪聲,這會(huì)進(jìn)一步影響到RF電路的性能。合理分配PCB的板層、采用星型拓?fù)涞腣cc引線,并在Vcc引腳加上適當(dāng)?shù)娜ヱ铍娙荩瑢⒂兄诟纳葡到y(tǒng)的性能,獲得最佳指標(biāo)。

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