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數字存儲示波器作為測試技術的重要，工具，被廣泛應用于各個領域，并逐步取代傳統模擬示波器。其采樣數據是波形運算和分析的基礎，直接影響到整個數字存儲示波器的準確性。從這點出來，提出采用現場可編程邏軋器件（FPGA）作為數字存儲示波器采樣控制系統的核心，從芯片間有效協助的角度，基于FPGA 設計ARM 接［ ］通信控制模塊和外圍芯片驅動功能模塊，以FPGA 為核心有效地組織其它芯片，共同完成數字存儲示波器數據采樣過程，確保數據按需求采樣，有效地提高數字存儲示波器的采樣效率和數據的可靠性。
1數字存儲示波器的總體設計方案
數字存儲示波采用雙處理器（ARM+FPGA）的嵌入式系統設計方案，ARM 內嵌WINCE操作系統，整個采樣系統主要在FPGA 里完成，從功能的角度分成采樣信息處理子系統與采樣控制子系統，本文著重介紹采樣控制子系統的驅動部分，由ARM 接［ ］控制模塊與芯片驅動模塊組成。如圖1所示：
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