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該文件描述了多通道緩沖串行端口（MCBSP）的263X/28 23 X設備。
這個設備提供多達兩個高速多通道緩沖串行端口（McBSP），允許直接接口編解碼器和系統中的其他設備。MCBSP由一個數據流路徑和一個由六個引腳連接到外部設備的控制路徑組成，如圖1-1所示。
數據通過數據發送（DX）管腳用于發送，并通過數據接收（DR）管腳用于接收，被傳送到與McBSP接口的設備。時鐘和幀同步形式的控制信息通過以下管腳進行通信：CLKX（發送時鐘）、CLKR（接收時鐘）、FSX（發送幀同步）和FSR（接收幀同步）。
CPU和DMA控制器通過可經由內部外圍總線訪問的16位寬的寄存器與McBSP通信。CPU或DMA控制器將要發送的數據寫入數據發送寄存器（DXR1，DXR2）。寫入DXR的數據通過發送移位寄存器（XSR1，XSR2）被移位到DX。類似地，DR管腳上的接收數據被移位到接收移位寄存器中。rs（RSR1，RSR2）并復制到接收緩沖寄存器（RBR1，RBR2）中。然后將RBR的內容復制到DRR，DRR可以由CPU或DMA控制器讀取。這允許同時進行內部和外部數據通信。
如果串行字長是8位、12位或16位，則不使用DRR2、RBR2、RSR2、DXR2和XSR2（寫入、讀取或移位）。對于較大的字長，這些寄存器需要保持最重要的位。
幀和時鐘環回是在芯片級上實現的，以使CLKX和FSX能夠驅動CKR和FSR。如果啟用回環，則CLKR和FSR從CLKX和FSX焊盤獲得它們的信號；而不是CLKR和FSR引腳。
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