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為了避免PCIe傳輸過程中PIO寫延時、主機與嵌入式處理系統(tǒng)交互次數過多等問題對于傳輸帶寬的影響，設計了一種基于命令緩沖機制的直接存儲訪問（ DMA）控制器以提高傳輸帶寬利用率。采用FPGA端內部設置命令緩沖區(qū)的方式，使得DMA控制器可以緩存PC端的數據傳輸請求，FPGA根據自身需求動態(tài)地訪問PC端存儲空間，增強了傳輸靈活性；同時，提出一種動態(tài)拼接的DMA調度方法，通過合并相鄰存儲區(qū)訪問請求的方式，進一步減少主機與硬件的交互次數和中斷產生次數。系統(tǒng)傳輸速率測試實驗中，DMA寫最高速率可達1 631 MB/s，DMA讀最高速率可達1582 MB/s，帶寬最大值可達PCIe總線理論帶寬值的85. 4qo；與傳統(tǒng)PIO方式的DMA傳輸方法相比，DMA讀帶寬提升58%，DMA寫帶寬提升36%。實驗結果表明，本設計能夠有效提升DMA傳輸效率，明顯優(yōu)于PIO方式。
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